PDF《2H SoC 开发板规格书》

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28 ? LED

13、LED14:3.3V 和5V 电源指示灯,系统上电后应该亮起. ? LED12:红灯,复位信号指示灯,系统复位时亮. 1.14板上电源和重启按钮 ? SW10:板上电源开关,接通 ATX 电源条件下,按下该按钮等 3~5 秒钟系统开机;

开 机状态下长按该按键

5 秒钟系统关机. ? SW11:复位按钮,按下该按钮后系统复位. Page

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28 2 技术参考 2.1 内存资源 2.1.1 可访问的内存 表3地址空间分配之 CPU 视角 地址空间 模块 说明 访问 0x0000,0000 C 0x0fff,ffff DDR 256MB BHWDQC 0x1000,0000 C 0x17ff,ffff PCIE PCIE MEM BHW 0x1800,0000 C 0x18ff,ffff PCIE PCIE IO/CFG/MEM-Lo BHW 0x1c00,0000 C 0x1dff,ffff LPC LPC MEM BHWDQC 0x1e00,0000 C 0x1eff,ffff SPI SPI Flash BHWDQC 0x1fc0,0000 C 0x1fcf,ffff Boot spi/nand/lpc BHWDQC 0x1fd0,0000 C 0x1fd7,ffff creg 中断与全局配置 BHW 0x1fd8,0000 C 0x1fdf,ffff cbus 片上配置寄存器 BHWD 0x1fe0,0000 C 0x1fe0,ffff USB 32KB EHCI, 32KB OHCI W 0x1fe1,0000 C 0x1fe1,ffff GMAC 32KB GMAC0, 32KB GMAC1 W 0x1fe2,0000 C 0x1fe2,ffff HDA BHW 0x1fe3,0000 C 0x1fe3,ffff SATA W 0x1fe4,0000 C 0x1fe4,ffff GPU W 0x1fe5,0000 C 0x1fe5,ffff DC W 0x1fe6,0000 C 0x1fe6,ffff OTG W 0x1fe7,0000 C 0x1fe7,ffff SPI SPI regs B 0x1fe8,0000 C 0x1fe8,ffff uart B 0x1fe9,0000 C 0x1fe9,ffff i2c W Page

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28 地址空间 模块 说明 访问 0x1fea,0000 C 0x1fea,ffff pwm W 0x1fec,0000 C 0x1fec,ffff hpet W 0x1fed,0000 C 0x1fed,ffff ac97 W 0x1fee,0000 C 0x1fee,ffff nand W 0x1fef,0000 C 0x1fef,7fff acpi W 0x1fef,8000 C 0x1fef,ffff rtc W 0x1ff0,0000 C 0x1ff0,ffff LPC LPC IO B 0x1ff1,0000 C 0x1ff1,00ff LPC LPC regs W 0x4000,0000 C 0x7fff,ffff PCIE PCIE MEM-Hi BHW 0x8000,0000 C 0xffff,ffff DDR 2GB BHWDQC 2.1.2 内存规划 表4龙芯 2HSoC 内存地址分配表 起始地址 结束地址 说明 地址

0 0x0000_0000_0000_0000 0x0000_0000_0020_0000 Runtime BIOS( Only exist during PMON alive) 地址

1 0x0000_0000_0000_0000 0x0000_0000_0F00_0000 Low memory 地址

2 0x0000_0000_0F00_0000 0x0000_0000_0FFF_FFFF Frame Buffer 空间 地址

3 0x0000_0001_1000_0000 0x0000_0001_1FFF_FFFF + MemSize C 256M Extended memory 2.2 连接器和标头 2.2.1 后面板连接器 后面板连接器有: ? CON6:串口,连接到 2H UART0 ? CON13:PS2 键盘鼠标接口 ? CON3:VGA 接口 Page

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28 ? CON

9、CON10:网口+双USB,其中 CON9 为网口 1,CON10 为网口

0 ? CON14:音频接口 2.2.2 组件侧连接器和标头 USB 接口(CON11) CON21 引脚定义 Pin

1 2

3 4

5 6

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10 Signal USB_PWR5 USB_PWR5 USB5- NC USB5+ NC GND GND NC 前面板接口(CON16) CON25 引脚定义 Pin

1 2

3 4

5 6

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9 Signal F_PANEL_5V FP_LED+ HD_LED# FP_LED- GND POWERBTN SYS_RST# GND NC EJTAG(CON4) Pin

1 2

3 4

5 6

7 Signal EJTAG_TRST GND EJTAG_TDI GND EJTAG_TDO GND EJTAG_TMS Pin

8 9

10 11 -

13 14 Signal GND EJTAG_TCK GND NC - NC 3.3V 2.3 跳线块 2H SoC 开发板上可以通过设置拨码开关改变硬件工作状态,拨码开关拨为 on 时,对 应信号线设置为

0 ,拨码开关拨为 off 时,对应信号线设置为

1 .拨码开关 SW

6、SW

7、SW9 连接的信号线如下图所示. Page

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28 各信号功能说明见下表: 称 信号名 描述 SYS_CLKSEL0 系统参考时钟选择 ? 0: SATA_XTAL ? 1: SYS_BAKCLK SYS_CLKSEL1 PCIE 参考时钟选择 ? 0: 内部 100MHz 时钟 ? 1: 从PCIE_XTAL 输入 Page

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28 ACPI_CLKSEL2 USB PHY1 时钟选择 ? 0: 内部时钟(此时 USB_XI1/XO1 可不接晶体) ? 1: 在USB_XI1/XO1 上的 12MHz 晶体 ACPI_CLKSEL3 ACPI 使能 ? 0: 不使用 ACPI 控制芯片 ? 1: 使用 ACPI 控制 NAND_D1 NAND_D0 硬件控制模式下 CPU PLL 倍频配置 ? 00: *4 ? 01: *6 ? 10: *8 ? 11: bypass NAND_D2 CPU PLL 纯硬件控制选择 ? 0: 关闭,CPU PLL 频率由软件配置 ? 1: 打开,CPU PLL 频率由 D1/D0 两位配置 NAND_D4 NAND_D3 硬件控制模式下 DDR PLL 倍频配置 ? 00: *5/3 ? 01: *8/3 ? 10: *10/3 ? 11: bypass NAND_D5 DDR PLL 纯硬件控制选择 ? 0: 关闭,DDR PLL 频率由软件配置 ? 1: 打开,DDR PLL 频率由 D4/D3 两位配置 NAND_CLE PCIE 从模式选择 ? 0: 关闭,PCIE 为1x4 或者 4x1 的root complex ? 1: 打开,PCIE 为x4 的endpoint Page